单选题
硬件描述语言一般包括VHDL、Verilog、Superlog、SystemC等,在VHDL设计中,一个完整的设计单元应当包含5部分,下面不属于这5部分的是______。
A、
实体
B、
结构体
C、
赋值
D、
配置
【正确答案】
C
【答案解析】
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