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简易逻辑分析仪的设计与应用 被引量:2

The Design and Application of New Useful Simple Logic Analyzer
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摘要 文章详细介绍基于CPLD+微控制器的简易逻辑分析仪设计方法,借助通用PC机及其强大的人机交互设备,实现了基于VC++6.0 Win32 API的数据分析显示界面,构成了简易逻辑分析仪。它不仅具有8路并行信号时序分析显示功能,而且还具有串行通信数据帧信息的实时检测与智能识别功能;对检测和调试各种数字逻辑电路和信息化系统十分有用且应用非常方便。经过大量的测试.该系统对串行通信数据帧信息的识别出错率约为1%。
作者 华坚 周杏鹏
出处 《仪器仪表与分析监测》 2007年第4期26-28,共3页 Instrumentation·Analysis·Monitoring
  • 相关文献

参考文献5

二级参考文献6

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  • 4Thomas.Moorby P R硬件描述语言Verilog [M].北京:清华大学出版社,2001..
  • 5常晓明.Verilog HDL实践与应用系统设计[M].北京:北京航空航天大学出版社,2004..
  • 6张亮.数字电路设计与Verilog HDL[M].北京:人民邮电出版社,2002..

共引文献9

同被引文献14

引证文献2

二级引证文献3

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