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异步DSP核心设计:更低功耗,更高性能

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摘要目前，处理器性能的主要衡量指标是时钟频率。绝大多数的集成电路（Ic）设计都基于同步架构，而同步架构都采用全球一致的时钟。这种架构非常普及，许多人认为它也是数字电路设计的唯一途径。然而，有一种截然不同的设计技术即将走上前台：异步设计。

作者 James Awad

机构地区 Octasic Inc.

出处《中国集成电路》 2008年第10期91-94,共4页 China lntegrated Circuit

关键词数字电路设计异步设计性能低功耗 DSP 时钟频率集成电路处理器

分类号 TP368.11 [自动化与计算机技术—计算机系统结构]

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中国集成电路

2008年第10期

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