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基于FPGA的(2,1,9)Viterbi译码器的实现

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摘要 Viterbi算法是卷积码的一种最大似然译码。文中介绍了(2,1,9)的Viterbi译码器的FPGA一种实现方案,其中ACS运算采用两个基四蝶形运算、幸存路径采用单指针进行回溯、路径度量存储为乒乓结构,电路经过综合后输出速率最高能达到2.3Mbps。

作者张红

机构地区福州大学物理与信息工程学院

出处《福建电脑》 2009年第8期95-96,共2页 Journal of Fujian Computer

关键词 VITERBI译码器幸存路径路径度量 FPGA

分类号 TN764 [电子电信—电路与系统] TN791 [电子电信—电路与系统]

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参考文献3

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福建电脑

2009年第8期

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