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硬件描述语言Verilog的建模技术

VERILOG HDL MODELING
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摘要 通过对Verilog语言的层次化建模、门级建模、数据流级建模、行为建模、开关级建模等各个抽象层次的研究 ,全面阐述了Verilog的建模方法。对于理解、使用和制订我国的Verilog语言标准会有所帮助。 Through analyzing the hierarchical modeling, gate-level modeling, dataflow modeling, behavioral modeling and switch-level modeling, this paper expounds the modeling method of Verilog HDL. It is useful to study and use the Verilog HDL, and it is also meaningful to constitute the language standard of Verilog HDL in China.
出处 《计算机应用》 CSCD 北大核心 2001年第4期1-3,共3页 journal of Computer Applications
基金 国家博士点建设基金 国家质量技术监督局-017课题
关键词 硬件描述语言 建模 VERILOG语言 集成电路 设计 HDL(Hardware Description Language) Verilog modeling IC design
  • 相关文献

参考文献3

  • 1蒋敬旗 刘明业.集成电路/计算机硬件描述语言标准Verilog IEEE std 1364-1995简介.第九届全国数字系统设计自动化暨全国协同设计会议论文集[M].,1999.53-55.
  • 2蒋敬旗,刁岚松,刘明业.集成电路/计算机硬件描述语言标准Verilog的标准化工作[J].中国标准化,2000(3):8-9. 被引量:2
  • 3蒋敬旗,第九届全国数字系统设计自动化暨全国协同设计会议论文集,1999年,53页

共引文献1

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