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Verilog-HDL在数字ASIC设计上的应用被引量：2

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摘要本文探索了在CADENCE环境下采用Verilog－HDL工具从顶到下设计ASIC的一般方法。工作着重在单元库的建立和RTL级的逻辑综合与优化技术。从系统功能出发，进行多层次设计，Verilog－HDL设计工具可以提供强有力支持。本文通过一个设计实例介绍了Verilog－HDL设计工具的应用。

作者须国宗梁洪昌黄焕章

机构地区中国科学院上海冶金所微电子学分部CAD室

出处《微处理机》 1996年第1期27-30,共4页 Microprocessors

关键词专用集成电路硬件描述语言设计数字式

分类号 TN402 [电子电信—微电子学与固体电子学]

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微处理机

1996年第1期

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