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IEEE802.11a基带系统中高速Viterbi译码器的FPGA实现 被引量:1

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摘要 提出了一种应用于IEEE802.11a协议系统的高速Viterbi译码器的新结构,以一种改进的归一化管理高效的解决了PMU单元的数据溢出问题、采用一种分块循环回溯算法以减少延时,并用Verilog语言具体实现。实验表明在该译码器以较少的资源实现了较高的速度,完全满足IEEE802.11a的协议标准,具有很高的实用价值。
出处 《中国新通信》 2016年第8期9-10,共2页 China New Telecommunications
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参考文献9

二级参考文献23

  • 1丁锐,杨知行,潘长勇.高速维特比译码器的设计[J].电讯技术,2004,44(4):51-54. 被引量:6
  • 2[2]Black P J.A 140-Mb/s,32-State,Radix-4 Viterbi Decoder[J].IEEE Journal of Solid-State Circuits,December,1992,27(12):1877-1992.
  • 3[3]Feygin G and Gulak P G.Architecture Tradeoffs for Survivor Sequence Memory Management in Viterbi Decoders[J].IEEE Transactions on Communications,March 1993,41(3):425-429.
  • 4[4]www.altera.com,"MegaCore:Viterbi Compiler User Guide",Version 4.4.0,April 2006,pp.15.
  • 5[5]Haene S,Burg A and Perrls D.FPGA Implementation of Viterbi Decoders for MIMO-BICM[C]//Thirty-Ninth Asilomar conference on Signal,System and Computers,2005:734-738.
  • 6[6]Sung Woo Choi and Sang sung Choi.200Mbit/s Viterbi decoder for UWB[C]//ICACT2005:904-907.
  • 7Horng-Dar Lin,David G Messerschmitt.Algorithms and Architectures for Concurrent Viterbi Decoding[A].IEEE,1989.
  • 8Hemant K Thapar,John M Cioffi.A Block Processing Method for Designing High-speed Viterbi Detectors[A].IEEE,1989.
  • 9王新梅 肖国镇.纠错码--原理与方法[M].西安:西安电子科技大学出版社,2001..
  • 10王新梅 肖国镇.纠错码-原理与方法[M].西安:西安电子科技大学出版社,2001..

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