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Viterbi译码中的路径度量存储管理 被引量:2

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摘要 大约束度卷积码的Viterbi译码器硬件复杂度大,限制了其速度。该文分析了Viterbi译码器的结构,从路径度量存储管理着手,合理地组织了存储器结构,简化了ACS和度量存储器之间的接口电路。提高了译码速率,使译码器便于FPGA实现。
作者 鄂炜 苏广川
出处 《无线电工程》 2003年第4期30-32,共3页 Radio Engineering
  • 相关文献

参考文献4

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  • 4Biver,M.,Kaeslin, H.,and Tommasini,C. In-place updating of path metrics in Viterbi decoders.IEEE J. Solid-State Circuits, 1989;24(8)

同被引文献11

引证文献2

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