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一种位同步时钟提取方案及实现
被引量：
27
A New Technique for Rapid Picking- up Bit Synchronous Clock in Digital Communication
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摘要
提出了一种数字通信中位同步时钟信号快速提取的方案。本方案比通常用的锁相环法具有同步快、实现简单等特点。据此方案设计了位同步时钟提取电路,并用CPLD予以实现,同时给出了该电路的仿真实验结果。
作者
王兰勋
荣民
机构地区
河北大学
出处
《无线电工程》
2003年第10期59-61,共3页
Radio Engineering
关键词
数字通信
位同步
时钟信号
锁相环
CPLD
分类号
TN919.34 [电子电信—通信与信息系统]
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