一种RISC型微处理器指令流水线结构 被引量：4

1

作者 齐家月 《小型微型计算机系统》 CSCD 北大核心 1995年第10期1-5,共5页

求文介绍一种ＲＩＳＣ微处理器的指令流水线结构、其工作原理及相关支持技术，包括ＨＥＬＰ指令的产生和插入、延迟控制转移以及硬件互锁。

关键词 微处理器 指令流水线 流水线结构 RISC型

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逻辑加密卡模拟宏单元电路分析

2

作者 齐家月 蒋涛 +2 位作者 邱晓海 周润德 葛元庆 《微电子学》 CAS CSCD 北大核心 1998年第5期316-320,共5页

介绍了逻辑加密卡模拟宏单元电路的结构，详细阐述了该电路中ＥＥＰＲＯＭ及电荷泵的工作原理。

关键词 集成电路卡 模拟宏单元 EEPROM IC卡

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一种RISC单片机的运算电路

3

作者 齐家月 沙璆 +1 位作者 周润德 骆晓东 《微电子学》 CAS CSCD 1996年第4期266-270,共5页

介绍了ＲＩＳＣ单片机ＰＩＣ１６Ｃ５７的运算部件，包括ＡＬＵ、Ｗ寄存器、移位寄存器和状态字寄存器，详细说明了其电路结构、工作原理及设计特点。

关键词 数字电路 RISC 单片机 算术逻辑单元 寄存器

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一种用于微控制器的振荡器及时钟产生电路 被引量：1

4

作者 齐家月 《微处理机》 1995年第3期18-21,共4页

本文介绍了一种灵活实用的用于微控制器的振荡器和时钟产生电路。该电路可由用户对配置EPROM编程，通过译码选择4种类型的振荡器（RC、标准晶体、高速晶体和低功耗晶体）。为了节省功耗，其详码器、振荡器和时钟发生器均有入睡／唤醒控制。

关键词 微控制器 振荡器 时钟产生电路 单片机

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一种RISC单片机的分块结构寄存器堆

5

作者 齐家月 骆晓东 《微电子学》 CAS CSCD 1996年第6期382-386,共5页

介绍了一种用于ＲＩＳＣ单片机ＰＩＣ１６Ｃ５７的寄存器堆，讨论了为降低功耗所采用的分块结构，详细说明了译码逻辑、ＳＲＡＭ单元。

关键词 数字集成电路 微处理器 寄存器堆 SRAM

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专用集成电路知识介绍(八) 计算机辅助设计及设计自动化

6

作者 齐家月 《小型微型计算机系统》 CSCD 北大核心 1989年第9期55-64,54,共11页

一、概述 随着集成电路复杂程度的不断增加,计算机辅助设计(CAD)和设计自动化(DA)变得日益重要。通常,在电路设计过程中,计算机的辅助作用体现在图6—1中所示的5个方面。

关键词 集成电路 CAD 计算机

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专用集成电路知识介绍(续八)

7

作者 齐家月 《小型微型计算机系统》 CSCD 北大核心 1989年第12期52-63,共12页

3.电路模拟程序SPICE (1)概述 SPICE是美国加州大学伯克莱分校开发的通用电路分析程序,自1975年问世以来,得到了广泛的应用。目前,仍在不断地改进、推出新版本。 SPICE可用于三种分析:线性交流分析、非线性直流分析和非线性瞬态分析。... 3.电路模拟程序SPICE (1)概述 SPICE是美国加州大学伯克莱分校开发的通用电路分析程序,自1975年问世以来,得到了广泛的应用。目前,仍在不断地改进、推出新版本。 SPICE可用于三种分析:线性交流分析、非线性直流分析和非线性瞬态分析。在交流分析与瞬态分析之前,程序将自动地进行直流分析,以确定非线性器件的直流工作点、瞬态初始状态及线性化小信号模型和参数。直流转移特性可在一给定的输入电压范围内进行计算, 展开更多

关键词 专用集成电路 集成电路

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单片机形式结构位EPROM及其功能

8

作者 齐家月 沙璆 《微型机与应用》 1996年第1期15-17,共3页

单片机PIC16C57的形式结构位EPROM的单元、读/写电路及相关逻辑的组成和功能,包括振荡器时钟发生器、代码保护电路及监视定时器WDT.

关键词 EPROM 振荡器 代码保护 监视定时器 单片机

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CACHE结构与设计

9

作者 齐家月 《微型机与应用》 1995年第4期16-18,共3页

cache的基本结构、读策略、写策略及各种结构的优缺点.

关键词 高速缓存 快速存储器 存储器 结构 设计

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备有可编程预定标器的单片机实时时钟/计数器

10

作者 齐家月 《微处理机》 1996年第3期9-16,共8页

本文介绍了一种用于单片机的实时时钟／计数器（RTCC），通过对单片机内备有的OPTION寄存器和预定标器编程，可以灵活方便地设置其分频率。文章详细讨论了RTCC、OPTION寄存器、预定标器及同步延时单元的电路结构、工作原理及设计特点。

关键词 单片机 可编程预定标器 实时时钟 计数器

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一种单片机多功能上电复位逻辑及监视计时器

11

作者 齐家月 《微处理机》 1995年第2期17-20,共4页

本文介绍了一种用于单片机和微处理器的在片多功能上电复位逻辑。通过在片内设立振荡器启动定时器来保证复位状态维持18ms，从而满足绝大多数情况下的复位要求而勿需外接RC电路。此外，通过备有监视计时器及其定标器可以有效地提高微机... 本文介绍了一种用于单片机和微处理器的在片多功能上电复位逻辑。通过在片内设立振荡器启动定时器来保证复位状态维持18ms，从而满足绝大多数情况下的复位要求而勿需外接RC电路。此外，通过备有监视计时器及其定标器可以有效地提高微机系统的抗干扰能力。 展开更多

关键词 微处理机 电复位逻辑 监视 计时器

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一种低功耗CMOS分频电路设计技术

12

作者 齐家月 沙璆 《微处理机》 1996年第2期8-11,21,共5页

本文首先介绍了为降低VLSI系统功耗而在产品定义、结构设计、逻辑设计和电路设计各个级别上所采取的技术，然后具体讨论了一种低功耗CMOS电路的设计特点，包括采用参考电压、动态电路和电平转换电路等。

关键词 CMOS电路 分频电路 电路设计

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PIC16C5×单片机I/O端口及编程

13

作者 齐家月 《微型机与应用》 1995年第5期18-19,35,共3页

采用RISC技术的单片机PIC16C5×的I/O端口,重点讨论其内部结构及在编程中需要注意的问题.

关键词 单片机 I/O端口 编程技术

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1998年IEEE定制集成电路会议概述

14

作者 齐家月 《国际学术动态》 1999年第1期35-37,共3页

1998年IEEE定制集成电路会议(CICC-Custom Integrated Circuits Conference)于5月11～14日在美国加州Santa Clara举行。会议有三项内容:一是教育讲座,二是CAD设备和技术展览,三是论文交流。会议宣读论文127篇。此次会议涉及面广且反映... 1998年IEEE定制集成电路会议(CICC-Custom Integrated Circuits Conference)于5月11～14日在美国加州Santa Clara举行。会议有三项内容:一是教育讲座,二是CAD设备和技术展览,三是论文交流。会议宣读论文127篇。此次会议涉及面广且反映了当今世界最新的技术,其重点集中在深亚微米,单片系统, 展开更多

关键词 深亚微米 定制集成电路 单片系统 模拟电路 低功耗 锁相环 系统设计 开关电容 当今世界 会议

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高性能RISC微处理器硬件仿真器设计 被引量：2

15

作者 刘振宇 齐家月 《计算机研究与发展》 EI CSCD 北大核心 2004年第8期1436-1441,共6页

在微处理器设计中 ,为了系统级软硬件协同仿真 ,在后端设计前必须采用硬件仿真器对设计进行系统验证 为此 ,采用FPGA设计 32位RISC流水线结构微处理器的硬件仿真器 此设计主要包括以下特点 :采用内存管理单元(MMU)可以实现虚拟地址管... 在微处理器设计中 ,为了系统级软硬件协同仿真 ,在后端设计前必须采用硬件仿真器对设计进行系统验证 为此 ,采用FPGA设计 32位RISC流水线结构微处理器的硬件仿真器 此设计主要包括以下特点 :采用内存管理单元(MMU)可以实现虚拟地址管理 ;包括片上Cache ,其中包括指令Cache(I Cache)和数据Cache(D Cache) ;采用标准SYSAD接口设计 ;包括片上乘除处理单元 (MDU) ;实现精确异常处理 设计采用XILINX公司的xc2v2 0 0 0实现 ,其工作频率为 展开更多

关键词 微处理器 RISC FPGA 硬件仿真器

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低功耗非全摆幅互补传输管加法器 被引量：4

16

作者 王宗静 齐家月 《微电子学与计算机》 CSCD 北大核心 2006年第5期8-11,共4页

文章提出了一种新型传输管全加器,该全加器采用互补传输管逻辑(ComplementaryPass-TransistorLog-ic)实现。与现有的CPL全加器相比:该全加器具有面积、进位速度和功耗上的优势;并且提供了进位传播信号的输出,可以更简单的构成旁路进位... 文章提出了一种新型传输管全加器,该全加器采用互补传输管逻辑(ComplementaryPass-TransistorLog-ic)实现。与现有的CPL全加器相比:该全加器具有面积、进位速度和功耗上的优势;并且提供了进位传播信号的输出,可以更简单的构成旁路进位加法器(CarrySkipAdder)。在此全加器基础上可以实现一种新型行波进位加法器(RippleCarryAdder),其内部进位信号处于非全摆幅状态,具有高速低功耗的特点。HSPICE模拟表明:对4位加法器而言,其速度接近CMOS提前进位加法器(CarryLookaheadAdder),而功耗减小了61%。适用于高性能、低功耗的VLSI电路设计。 展开更多

关键词 低功耗 全加器 非全摆幅 互补传输管逻辑 加法器

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32位RISC微处理器设计 被引量：1

17

作者 杨洸 齐家月 《微电子学》 CAS CSCD 北大核心 2001年第1期58-61,共4页

介绍了一种与 Motorola- Mcore兼容的 32位 RISC结构微处理器核的设计。从该处理器的整体结构的划分 ,到处理器内部各单元的设计 ,进行了比较详尽的阐述 ,最后给出了设计的综合结果 。

关键词 RISC 微处理器 数字集成电路

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一种高速低功耗多端口寄存器堆的设计

18

作者 丛高建 齐家月 《Journal of Semiconductors》 EI CAS CSCD 北大核心 2007年第4期614-618,共5页

通过使用特殊的存储单元,减小工作电流,设计了一种32×32bit的1写8读9端口寄存器堆,读操作位线和写操作位线都实现了低摆幅,结合使用自复位地址译码电路、门限时钟和优化的时序控制电路等,实现了高速和低功耗的目标,并用SMIC0.18μ... 通过使用特殊的存储单元,减小工作电流,设计了一种32×32bit的1写8读9端口寄存器堆,读操作位线和写操作位线都实现了低摆幅,结合使用自复位地址译码电路、门限时钟和优化的时序控制电路等,实现了高速和低功耗的目标,并用SMIC0.18μm工艺设计了全定制版图.在1.8V工作电压下用Hspice进行版图后仿真结果显示,写入时间为1.7ns,读取时间为1.32ns,时钟频率为500MHz时,9个端口同时工作的最大功耗为70mW. 展开更多

关键词 高速 低功耗 多端口 SRAM 寄存器堆

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逻辑加密IC卡的正向设计

19

作者 蒋涛 齐家月 《微电子学》 CAS CSCD 北大核心 1998年第1期36-40,共5页

介绍了逻辑加密ＩＣ卡的正向设计原理。详细阐述了ＩＣ卡数字部分的指令设计和ＶＨＤＬ描述。最后给出了ＶＨＤＬ代码的综合及其验证，说明该设计方法是一种通用性很强的逻辑加密ＩＣ卡设计方法。

关键词 IC卡 数字电路 VHDL 计算机辅助设计

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8086微处理器的内部结构特点

20

作者 岳震伍 齐家月 +1 位作者 羊性滋 蒋志 《微处理机》 1985年第1期8-15,共8页

一、整体结构概述8086微处理器的整体结构框图示于图1中。它由两个处理器组成,一个是上半部分的总线接口部件BIU,一个是下半部分的执行部件EU。二者各受独立的控制,有相同的时钟但工作时并不同步。BIU的组成包括形成地址的段寄存器及加... 一、整体结构概述8086微处理器的整体结构框图示于图1中。它由两个处理器组成,一个是上半部分的总线接口部件BIU,一个是下半部分的执行部件EU。二者各受独立的控制,有相同的时钟但工作时并不同步。BIU的组成包括形成地址的段寄存器及加法器、程序计数器PC。 展开更多

关键词 地址寄存器 EU 结构框图 总线 微程序控制存储器 分组译码 微处理器 BIU 指令队列 寄存器堆 ROM 逻辑控制 存储器周期

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