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ADSP-TS101高速全双工Link收发器FPGA设计
被引量：
2
1
作者
王鹏
连帅彬
+2 位作者
孙秋菊
黄文霞
钟莉娟
《信阳师范学院学报（自然科学版）》
CAS
北大核心
2015年第2期259-262,共4页
提出并实现了一种基于ADI Tiger SHARC101 Link协议的高速通信收发器TPGA设计方案,能同时在接口时钟的上升沿和下降沿收发数据,进而实现FPGA与DSP、以及FPGA片间的无缝连接.经ISE综合与布局布线验证,整个系统仅占用452个Slice,最高工作...
提出并实现了一种基于ADI Tiger SHARC101 Link协议的高速通信收发器TPGA设计方案,能同时在接口时钟的上升沿和下降沿收发数据,进而实现FPGA与DSP、以及FPGA片间的无缝连接.经ISE综合与布局布线验证,整个系统仅占用452个Slice,最高工作频率超过300 MHz,数据传输率可达4.8 Gb/s.
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关键词
高速通信
LINK协议
双倍速率传输
数据收发器
下载PDF
职称材料
如何选购DDR内存
2
作者
牛来
《电脑》
2002年第8期81-81,共1页
关键词
DDR内存
双
倍
数据
传输
速率
芯片组
PCB板
下载PDF
职称材料
题名
ADSP-TS101高速全双工Link收发器FPGA设计
被引量：
2
1
作者
王鹏
连帅彬
孙秋菊
黄文霞
钟莉娟
机构
信阳师范学院物理电子工程学院
中国空空导弹研究院航空制导武器航空科技重点实验室
出处
《信阳师范学院学报（自然科学版）》
CAS
北大核心
2015年第2期259-262,共4页
基金
航空科学基金项目(20130112002)
河南省教育厅自然科学研究计划项目(2011B510015)
文摘
提出并实现了一种基于ADI Tiger SHARC101 Link协议的高速通信收发器TPGA设计方案,能同时在接口时钟的上升沿和下降沿收发数据,进而实现FPGA与DSP、以及FPGA片间的无缝连接.经ISE综合与布局布线验证,整个系统仅占用452个Slice,最高工作频率超过300 MHz,数据传输率可达4.8 Gb/s.
关键词
高速通信
LINK协议
双倍速率传输
数据收发器
Keywords
high-rate communication
Link protocol
double date rate transmission
data transceiver
分类号
TN911.2 [电子电信—通信与信息系统]
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职称材料
题名
如何选购DDR内存
2
作者
牛来
出处
《电脑》
2002年第8期81-81,共1页
关键词
DDR内存
双
倍
数据
传输
速率
芯片组
PCB板
分类号
TP333 [自动化与计算机技术—计算机系统结构]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
ADSP-TS101高速全双工Link收发器FPGA设计
王鹏
连帅彬
孙秋菊
黄文霞
钟莉娟
《信阳师范学院学报（自然科学版）》
CAS
北大核心
2015
2
下载PDF
职称材料
2
如何选购DDR内存
牛来
《电脑》
2002
0
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职称材料
已选择
0
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导出题录
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参考文献
引证文献
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