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基于HDL Designer的FPGA静态测试技术研究
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作者 刘静静 黄显果 +1 位作者 王振 常卫 《工业控制计算机》 2021年第12期68-69,72,共3页
为保障电力行业软件产品FPGA测试质量,结合电力系统相关FPGA软件产品研究,利用Mentor HDL Designer工具进行静态测试,为有效精简测试结果条目,提高静态测试效率和质量,提出了一种基于测试项目的最小规则库优化方案,并给出了搭建测试环... 为保障电力行业软件产品FPGA测试质量,结合电力系统相关FPGA软件产品研究,利用Mentor HDL Designer工具进行静态测试,为有效精简测试结果条目,提高静态测试效率和质量,提出了一种基于测试项目的最小规则库优化方案,并给出了搭建测试环境遇到的典型问题解决办法。最后对最小规则库进行验证,测试结果表明,该方案能有效保障FPGA软件产品测试质量。 展开更多
关键词 静态测试 HDL Designer 最小规则库 FPGA
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