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英特尔IDF论坛发布首款“芯片上系统”
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《电脑编程技巧与维护》 2007年第5期3-3,共1页
在日前召开的北京英特尔开发者论坛上,英特尔发言人表示,计划在2008年推出公司有史以来第一款“芯片上系统”系统,主要基于消费者和企业电脑平台。
关键词 芯片上系统 英特尔 论坛 IDF 电脑平台 开发者 消费者
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多媒体SOC芯片的低功耗设计 被引量:2
2
作者 马庆容 程君侠 沈磊 《半导体技术》 CAS CSCD 北大核心 2007年第9期796-799,共4页
从集成电路功耗原理出发,分析了CMOS电路功耗的来源,从集成电路设计的系统级、算法级、架构级、电路/门级以及工艺/器件级五个抽象层次出发,整理、总结了当前主要的低功耗设计方法,并在实际的移动多媒体处理应用SOC芯片设计中,平衡产品... 从集成电路功耗原理出发,分析了CMOS电路功耗的来源,从集成电路设计的系统级、算法级、架构级、电路/门级以及工艺/器件级五个抽象层次出发,整理、总结了当前主要的低功耗设计方法,并在实际的移动多媒体处理应用SOC芯片设计中,平衡产品成本、设计复杂度、设计环境等多种因素,确定并应用了适合设计对象的低功耗设计方法的组合。通过对于样片功耗的测试分析,低功耗设计方法(组合)取得了预期的效果,实现了较低的动态功耗与很低的静态功耗。 展开更多
关键词 低功耗 芯片上系统 设计方法
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高密度封装进展(之一)——元件全部埋置于基板内部的系统集成封装(一)
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作者 田民波 《现代表面贴装资讯》 2003年第4期20-28,共9页
关键词 高密度封装 SMT封装 电子封装 芯片上系统 SOC 集成电路 电子元器件
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基于IP复用的片上级系统的构建与验证 被引量:7
4
作者 胡越黎 周谌 《计算机测量与控制》 CSCD 北大核心 2010年第3期629-631,共3页
以一款基于IP复用的片上级系统(SHU-MV07)的设计过程为具体对象,介绍了多个IP核嵌入同一个系统所遇到的问题和解决方法;不仅给出每个IP核的嵌入方案,而且给出了整个片上级系统的验证方法;对于由模拟的IP核的嵌入而带来的验证问题,提出... 以一款基于IP复用的片上级系统(SHU-MV07)的设计过程为具体对象,介绍了多个IP核嵌入同一个系统所遇到的问题和解决方法;不仅给出每个IP核的嵌入方案,而且给出了整个片上级系统的验证方法;对于由模拟的IP核的嵌入而带来的验证问题,提出了一种基于NanoSim的混合信号条件下的全芯片级的验证方法;采用本方法验证了数模混合系统级的芯片(SHU-MV07)的时间大大缩短,并且通过了流片一次成功,证明了本方法的有效性。 展开更多
关键词 IP复用 上系统芯片 数模混合验证
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基于NanoSim-VCS的芯片级混合信号验证 被引量:2
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作者 胡越黎 经文怡 宣祥光 《上海大学学报(自然科学版)》 CAS CSCD 北大核心 2009年第1期42-46,共5页
在混合信号系统芯片设计过程中,复杂的全芯片系统验证以及数字单元和模拟IP电路间的接口节点分析成为设计的瓶颈.提出一种基于NanoSim-VCS的混合信号验证方法,以SHU-MV06芯片为具体对象,对一个包括Verilog和SPICE的数模混合系统设计进... 在混合信号系统芯片设计过程中,复杂的全芯片系统验证以及数字单元和模拟IP电路间的接口节点分析成为设计的瓶颈.提出一种基于NanoSim-VCS的混合信号验证方法,以SHU-MV06芯片为具体对象,对一个包括Verilog和SPICE的数模混合系统设计进行验证.这一验证方法在仿真的速度和精度间进行折衷,在保证一定精度的基础上大大缩短了仿真时间,提高了验证效率,使设计人员在早期仿真阶段就能及时发现设计中的问题,改进了设计质量.采用此方法验证的数模混合系统级芯片SHU-MV06一次流片成功,表明了此方法的正确性和有效性. 展开更多
关键词 模拟数字混合信号验证 NanoSim—VCS 上系统芯片SoC
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基于MPSoC的Sub-6 GHz频段SDR测试系统设计与实现 被引量:2
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作者 黄继业 谢辉 董哲康 《实验室研究与探索》 CAS 北大核心 2022年第8期14-18,76,共6页
为实现5G高带宽信号的快速测试和复杂通信算法的快速验证,提出了一种基于MPSoC的Sub-6 GHz频段软件无线电(SDR)测试实验平台。平台采用Xilinx ZYNQ UltraScale~+MPSoC和射频收发器ADRV9009搭建,两者通过JESD204B高速串行接口进行数据流... 为实现5G高带宽信号的快速测试和复杂通信算法的快速验证,提出了一种基于MPSoC的Sub-6 GHz频段软件无线电(SDR)测试实验平台。平台采用Xilinx ZYNQ UltraScale~+MPSoC和射频收发器ADRV9009搭建,两者通过JESD204B高速串行接口进行数据流传输。采用软硬件协同设计思想,具备高可重构性和移植性,其中,硬件/PL逻辑部分负责射频信号到基带信号的转换与信号处理;软件部分依托Petalinux和Libiio的加持,可对测试系统进行全局控制。此外,该系统还拥有超宽调谐范围、可配置MIMO等优势,可作为5G SDR实验平台使用。经高带宽信号收发实验验证,该测试系统满足5G Sub-6 GHz信号收发链路要求,信道可靠性较高,在5G信号测试和算法原型验证方面,具有一定的应用价值。 展开更多
关键词 通信测试 芯片集成多处理器片上系统 第五代移动通信技术 宽带收发器 软件无线电实验平台
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RFSoC中ADC的SFDR优化技术研究
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作者 白锦 刘生 汪洋 《电子质量》 2024年第9期1-7,共7页
赛灵思(Xilinx)推出了一款集成了高性能模数/数模转换器(ADC/DAC)的单芯片射频片上系统(RFSoC),由于其具有极高的ADC性能指标和系统集成度,因而得到了广泛的应用。ADC采用时间交织(TI)采样技术,由多个子ADC进行采集组合来提高采样速率,... 赛灵思(Xilinx)推出了一款集成了高性能模数/数模转换器(ADC/DAC)的单芯片射频片上系统(RFSoC),由于其具有极高的ADC性能指标和系统集成度,因而得到了广泛的应用。ADC采用时间交织(TI)采样技术,由多个子ADC进行采集组合来提高采样速率,但是由于各子ADC不可能做到工艺完全相同,因此该技术存在偏置失配、增益失配和时间失配等问题,从而造成频谱出现杂散,降低了无杂散动态范围(SFDR)指标。基于RFSoC中ADC的杂散问题,分析了ADC的校准结构,探讨了对SFDR指标进行性能优化的技术方法。大量的实验和分析结果表明,该方法有效地提高了ADC的SFDR指标,具有良好的效果。 展开更多
关键词 芯片射频片上系统 模数转换器 无散杂动态范围 时间交织采样 杂散
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应用直接编程接口技术提高片上系统的UVM验证重用性 被引量:5
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作者 任传宝 崔建国 +2 位作者 鲁迎春 黄正峰 易茂祥 《微电子学与计算机》 2021年第6期20-26,32,共8页
提出一种提高片上系统的UVM验证重用性方案,应用直接编程接口技术,实现通用验证方法学和C语言程序的交互通信.该方法不仅降低了通用验证方法学使用的复杂度,而且使得C语言测试用例可以在不同的测试层次中移植重用,例如C测试代码可以从... 提出一种提高片上系统的UVM验证重用性方案,应用直接编程接口技术,实现通用验证方法学和C语言程序的交互通信.该方法不仅降低了通用验证方法学使用的复杂度,而且使得C语言测试用例可以在不同的测试层次中移植重用,例如C测试代码可以从模块级到片上系统级的重用.以SPI控制器验证本方案,搭建其UVM验证平台,编写大量的UVM和C测试用例,使其功能覆盖率达到100%,并通过虚拟处理器方案保证C测试用例从模块级复用到系统级的可行性.实验过程中激励开发简单且调试方便,可以实现UVM环境和测试用例的重用,从而提高片上系统的UVM验证重用性,达到缩短芯片开发时间的目的. 展开更多
关键词 通用验证方法学(UVM) 重用性 直接编程接口(DPI) 上系统芯片(SOC) 虚拟处理器
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基于ESL的华睿2号SoC系统级架构设计 被引量:2
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作者 刘静 周海斌 《南京师范大学学报(工程技术版)》 CAS 2016年第4期69-77,共9页
华睿2号是我国自主研发的一款8核微处理器,基于CMOS 40nm工艺设计,片内集成8核DSP、AXI总线以及PCIE/DDR3等多种高速接口的大规模片上系统芯片(So C).鉴于华睿2号设计复杂,需使用电子系统级(ESL)解决方案,确定So C级架构.ESL设计方法学... 华睿2号是我国自主研发的一款8核微处理器,基于CMOS 40nm工艺设计,片内集成8核DSP、AXI总线以及PCIE/DDR3等多种高速接口的大规模片上系统芯片(So C).鉴于华睿2号设计复杂,需使用电子系统级(ESL)解决方案,确定So C级架构.ESL设计方法学已被越来越多的复杂So C设计所采纳,利用可裁剪的TLM建模方法快速搭建系统,进行系统级验证,探索不同架构设计对系统性能的影响,从而寻找最优方案.本文利用Synopsys ESL解决方案,创建So C不同的架构,并在创建的架构上运行雷达信号处理典型应用,分析处理时间、总线压力等架构性能,通过优劣对比最终确定最优架构. 展开更多
关键词 华睿2号 上系统芯片 电子系统 架构设计
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一款深亚微米射频SoC芯片的后端设计与实现
10
作者 张志鹏 张超 刘铁锋 《微处理机》 2017年第6期1-6,共6页
随着集成电路的发展,片上系统芯片(SoC)技术广泛应用于多种领域中,越来越多的射频、模拟、存储器模块集成到一块芯片中。SoC芯片后端设计面临尺寸特征小,芯片规模大,物理设计复杂程度高等问题。良好的芯片版图设计是集成电路实现和成功... 随着集成电路的发展,片上系统芯片(SoC)技术广泛应用于多种领域中,越来越多的射频、模拟、存储器模块集成到一块芯片中。SoC芯片后端设计面临尺寸特征小,芯片规模大,物理设计复杂程度高等问题。良好的芯片版图设计是集成电路实现和成功的基础之一。介绍了基于台积电0.18μm ULL低功耗工艺设计的射频SoC电路结构,在此基础上,详细说明了后端版图设计流程与布局规划,重点介绍了时钟模块设计,多时钟电路及复杂时序关系设计的后端布局处理,供电设计以及布线优化方法和技巧,对各类相关芯片的后端设计具有良好的借鉴意义。 展开更多
关键词 上系统芯片 后端布局 多时钟设计 时钟生成 后端流程 供电设计
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芯片设计服务业的兴起及世芯电子的独特定位
11
作者 周佳敏 《集成电路应用》 2003年第11期55-56,共2页
1 芯片设计服务的兴起根据国际知名市场调查公司Cartner Dataquest指出:2001年全世界设计服务市场总值高达20.7亿美元(US(?)2.7Billion),其中芯片设计服务总值占了约百分之五十。Dataquest估计全球约有800家芯片设计服务公司,形成百家... 1 芯片设计服务的兴起根据国际知名市场调查公司Cartner Dataquest指出:2001年全世界设计服务市场总值高达20.7亿美元(US(?)2.7Billion),其中芯片设计服务总值占了约百分之五十。Dataquest估计全球约有800家芯片设计服务公司,形成百家争鸣的盛况。 展开更多
关键词 芯片设计服务业 ASIC 世芯电子公司 市场竞争 上系统芯片
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基于复用的SOC测试技术 被引量:3
12
作者 王红 邢建辉 杨士元 《半导体技术》 CAS CSCD 北大核心 2004年第5期49-51,共3页
复用不仅是SOC设计思想的核心,也是解决SOC测试的基础。本文在分析SOC的基本概念和特点的基础上,从复用的角度对现有的SOC测试方案进行分析和综述,并探讨了亟待解决的问题。
关键词 芯片上系统 测试 SOC 集成电路 复用技术
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基于SOPC的多路HART协议转换及智能I/O模块设计
13
作者 倪晓明 田雨聪 《电网技术》 EI CSCD 北大核心 2008年第22期68-71,共4页
该设计基于可编程芯片上系统的解决方案,在单片现场可编程门阵列芯片上同时实现CPU控制器、8路异步收发器、8路可寻址远程传感器高速通道(highway addressable remote transducer,HART)协议设备的独立调制解调器等部件,可实现8路HART协... 该设计基于可编程芯片上系统的解决方案,在单片现场可编程门阵列芯片上同时实现CPU控制器、8路异步收发器、8路可寻址远程传感器高速通道(highway addressable remote transducer,HART)协议设备的独立调制解调器等部件,可实现8路HART协议转换及智能I/O采集功能,不仅结构简单,而且成本低廉,解决了多路HART设备的快速数据采集和响应问题。此外,该模块采用异步采集的方法,自动对HART设备进行周期性的采集和数据的实时缓冲,有效地提高了对上位机通信的响应速度。该设计已成功应用于EDPF-NT分散控制系统中。 展开更多
关键词 可寻址远程传感器高速通道(HART) 可编程芯片上系统(SOPC) 协议转换 调制解调器
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基于微控制单元的彩色图像加密无线通信方案 被引量:2
14
作者 贾晓霞 邢进生 《南京师大学报(自然科学版)》 CAS CSCD 北大核心 2022年第2期98-105,共8页
为解决无线信道中的彩色图像通信安全问题,提出了一种基于微控制单元(micro controller units,MCU)的彩色图像实时加密通信方案.利用所提密码系统提高混沌序列的随机性,通过基于混沌映射的伪随机数生成器(pseudo random number generato... 为解决无线信道中的彩色图像通信安全问题,提出了一种基于微控制单元(micro controller units,MCU)的彩色图像实时加密通信方案.利用所提密码系统提高混沌序列的随机性,通过基于混沌映射的伪随机数生成器(pseudo random number generator,PRNG)和XOR操作进行图像加密,并通过RS-232端口发送嵌入式加密系统的输出.在PIC 16F873A微控制器上实施了提出的方案,并在无线链路上进行了实验.结果表明,与其他优秀加密方法相比,所提方案提供了更高的安全性,可抵御各种已知攻击.此外,使用双浮点精度的PRNG的处理速度为13.52 Mbit/s,能够满足现实应用的实时通信要求. 展开更多
关键词 混沌映射 伪随机数字生成器 微控制单元 芯片上系统 机器到机器
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SIMULATION AND PERFORMANCE ANALYSIS OF NETWORK ON CHIP ARCHITECTURES 被引量:1
15
作者 葛芬 吴宁 《Transactions of Nanjing University of Aeronautics and Astronautics》 EI 2010年第4期326-332,共7页
The network on chip(NoC)is used as a solution for the communication problems in a complex system on chip(SoC)design.To further enhance performances,the NoC architectures,a high level modeling and an evaluation met... The network on chip(NoC)is used as a solution for the communication problems in a complex system on chip(SoC)design.To further enhance performances,the NoC architectures,a high level modeling and an evaluation method based on OPNET are proposed to analyze their performances on different injection rates and traffic patterns.Simulation results for general NoC in terms of the average latency and the throughput are analyzed and used as a guideline to make appropriate choices for a given application.Finally,a MPEG4 decoder is mapped on different NoC architectures.Results prove the effectiveness of the evaluation method. 展开更多
关键词 microprocessor chips ARCHITECTURE network on chip system on chip performance analysis
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可定制的便携式集成产品即将面世
16
作者 Gene A.Frantz 代永平 《现代显示》 2005年第4期22-24,29,共4页
SoC技术将彻底改变便携式产品的设计方案。甚至随着便携产品功能越来越多样化,显示器及其界面接口设计也将更多有赖于SoC的集成容量。
关键词 便携式产品 芯片上系统 芯片集成
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SOC技术成为消费电子源动力
17
《半导体技术》 CAS CSCD 北大核心 2001年第5期31-33,共3页
利用超大规模集成电路,在一枚芯片上集成多个复杂系统的芯片上系统技术(SOC)为新型消费电子市场提供了新空间。新兴的家用网关、ST Euterpe数字语音处理芯片、DataPlay微光学引擎的核心都依赖SOC技术。
关键词 芯片上系统 消费电子 集成电路
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片上网络拓朴优化:在离散平面上布局与布线 被引量:8
18
作者 马立伟 孙义和 《电子学报》 EI CAS CSCD 北大核心 2007年第5期906-911,共6页
微系统芯片(System-on-Chip,SoC)发展到今天,集成密度指数增长和芯片面积的急剧膨胀使得全局连线的延时上升,可靠性下降,成为集成电路的设计瓶颈.片上网络(Network-on-Chip,NoC)是解决整个芯片上数据有效传输的结构之一,以片上网络为基... 微系统芯片(System-on-Chip,SoC)发展到今天,集成密度指数增长和芯片面积的急剧膨胀使得全局连线的延时上升,可靠性下降,成为集成电路的设计瓶颈.片上网络(Network-on-Chip,NoC)是解决整个芯片上数据有效传输的结构之一,以片上网络为基础通信架构的微系统芯片称为片上网上系统芯片(System-on-Network-on-Chip,SoNoC).微系统芯片内通信模式兼有随机性和确定性,应该根据特定应用的通信特征设计片上网络.本文在确定SoNoC设计流程的基础上,根据SoNoC的通信特征,选择了合适的离散平面结构,对SoNoC的运算及控制等模块进行布局、对模块间的通信依赖关系进行布线,发展出FRoD(Floor-plan and Routing on Discrete Plane)算法,以自动生成片上网络的拓扑结构.该算法定义了离散平面的一般表示方法,并在四种典型的离散平面上使用不同规模的随机系统完成了系列实验.为了处理系统和网络之间的耦合关系,逐点分裂的布局算法可以逐步学习和适应系统的通信需求,同时优化系统的执行时间和通信能量,在运行随机任务流图的模拟系统上与随机布局结果相比可以节省30%左右的通信能量,20%左右的系统通信时间.串行、并行和串并混合的布线算法使用最短路径把通信关系分布在离散平面的通道上,使不同的通信关系尽量复用网络通道,与全连接网络相比可以节省10%到30%的面积代价. 展开更多
关键词 系统芯片 片上网络 片上网上系统芯片 片上网络综合
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基于ARM的SDIO驱动设计 被引量:7
19
作者 黄晓曦 黄世震 《计算机与数字工程》 2010年第1期159-163,共5页
在介绍了基于ARM的ark1600芯片和SDIO的特点、内部结构、工作模式、命令与响应之后分析了SDIO的驱动的主要内容、初始化过程和需要获取的卡上信息,说明如何进行寄存器读写和配置。该驱动适用于所有SDIO的通用层部分,在arkmicro公司的ar... 在介绍了基于ARM的ark1600芯片和SDIO的特点、内部结构、工作模式、命令与响应之后分析了SDIO的驱动的主要内容、初始化过程和需要获取的卡上信息,说明如何进行寄存器读写和配置。该驱动适用于所有SDIO的通用层部分,在arkmicro公司的ark芯片SOPC验证平台上成功初始化了Toshiba的Type-B蓝牙SDIO卡,获取了该卡的信息,并对其进行了功能上的配置。 展开更多
关键词 上系统芯片 SDIO接口 驱动 设计
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基于遗传算法的分割可测试设计
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作者 李宇飞 余宙 付宇卓 《上海交通大学学报》 EI CAS CSCD 北大核心 2007年第11期1774-1777,1782,共5页
基于遗传算法,建立了片上系统芯片(SOC)的图模型,对逻辑级的SOC结构进行精确量化;然后,对模型应用遗传算法进行分析,得到了电路的理想分割结果;最后,基于分割结果,实现一颗SOC的可测试设计(DFT).实验结果表明,在分割的均匀度与附加电路... 基于遗传算法,建立了片上系统芯片(SOC)的图模型,对逻辑级的SOC结构进行精确量化;然后,对模型应用遗传算法进行分析,得到了电路的理想分割结果;最后,基于分割结果,实现一颗SOC的可测试设计(DFT).实验结果表明,在分割的均匀度与附加电路代价方面,该方法相比原有的DFT方法有显著的改进. 展开更多
关键词 上系统芯片 可测试设计 测试功耗 分割 遗传算法
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