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SDRAM控制器的设计与VHDL实现 被引量：19
1
作者 田丰 邓建国 +1 位作者 李巍 贾治华 《电子技术应用》 北大核心 2005年第2期74-77,共4页
介绍了SDRAM的存储体结构、主要控制时序和基本操作命令,并且结合实际系统,给出了一种用FPGA实现的通用SDRAM控制器的方案。
关键词 sdram控制器 VHDL 命令 FPGA实现 通用 存储 时序 方案 基本操作
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用于HDTV视频解码器的高性能SDRAM控制器 被引量：11
2
作者 赵强 罗嵘 +1 位作者 汪蕙 杨华中 《电子与信息学报》 EI CSCD 北大核心 2007年第6期1332-1337,共6页
该文提出了一种适用于HDTV视频解码器的高性能SDRAM控制器。通过为SDRAM控制器设置多个端口并集成仲裁功能,该SDRAM控制器可以取代传统的总线+DMA结构,为解码器中的功能单元有效地分配存储器的带宽资源。该文提出的SDRAM控制器内建流水... 该文提出了一种适用于HDTV视频解码器的高性能SDRAM控制器。通过为SDRAM控制器设置多个端口并集成仲裁功能,该SDRAM控制器可以取代传统的总线+DMA结构,为解码器中的功能单元有效地分配存储器的带宽资源。该文提出的SDRAM控制器内建流水线式的地址和数据路径,配合SDRAM本身流水处理指令的特性,能够无延时地处理各个端口上的存储器访问请求,从而降低了对片上缓存的需求。仿真综合结果表明,该文设计的SDRAM控制器满足HDTV解码的性能要求,且与总线+DMA结构相比,片上缓存容量减少了约70%。 展开更多
关键词 HDTV sdram控制器 视频 解码
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DDR2 SDRAM控制器的设计与实现 被引量：15
3
作者 赵天云 王洪迅 +1 位作者 郭雷 毕笃彦 《微电子学与计算机》 CSCD 北大核心 2005年第3期203-207,共5页
本文介绍了DDR2SDR AM的基本特征,并给出了一种DD R2SDRAM控制器的设计方法,详述了其基本结构和设计思想,并使用Altera公司的FPGA器件Stratix EP2S30F672C3进行了实现和验证,同时给出了设计与实现中应注意的若干问题。
关键词 DDR2 sdram控制器 FPGA 锁相环 状态机
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地震数据采集中基于FPGA的多DDR SDRAM控制器设计 被引量：11
4
作者 马灵 杨俊峰 +1 位作者 宋克柱 王砚方 《中国科学技术大学学报》 CAS CSCD 北大核心 2010年第9期939-945,共7页
实现高速大容量数据的无死时间乒乓存储是地震数据采集系统的一项关键技术,本设计采用在一片FPGA中,通过共享同一个PLL和DLL来实现2个DDR SDRAM控制器,应用于海上高精度地震拖缆采集与记录系统中光纤控制接口板上,完成对水下地震采集数... 实现高速大容量数据的无死时间乒乓存储是地震数据采集系统的一项关键技术,本设计采用在一片FPGA中,通过共享同一个PLL和DLL来实现2个DDR SDRAM控制器,应用于海上高精度地震拖缆采集与记录系统中光纤控制接口板上,完成对水下地震采集数据的接收、乒乓缓存、数据拼接及时序转道序功能.最终系统仿真和测试结果表明,该控制器能够在133MHz频率上稳定运行,达到了预期的设计目标. 展开更多
关键词 FPGA DDR sdram控制器 乒乓存储 SignalTapⅡ逻辑分析仪
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基于FPGA的DDR3 SDRAM控制器设计及实现 被引量：23
5
作者 张刚 贾建超 赵龙 《电子科技》 2014年第1期70-73,共4页
DDR3 SDRAM是第三代双倍数据传输速率同步动态随机存储器,以其大容量、高速率和良好的兼容性得到了广泛应用。文中介绍了DDR3的特点和操作原理,以及利用MIG软件工具在Virtex-6系列FPGA中实现DDR3 SDRAM控制器的设计方法,并进行硬件测试... DDR3 SDRAM是第三代双倍数据传输速率同步动态随机存储器,以其大容量、高速率和良好的兼容性得到了广泛应用。文中介绍了DDR3的特点和操作原理,以及利用MIG软件工具在Virtex-6系列FPGA中实现DDR3 SDRAM控制器的设计方法,并进行硬件测试。验证了DDS3控制器的可行性,其工作稳定、占用资源少、可植性强等。 展开更多
关键词 FPGA DDR3 sdram控制器 MIG
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高速图像存储系统中SDRAM控制器的实现 被引量：35
6
作者 王骞 丁铁夫 《液晶与显示》 CAS CSCD 北大核心 2006年第1期48-52,共5页
SDRAM作为大容量存储器在高速图像处理中具有很大的应用价值。但由于SDRAM的结构和SRAM不同,其控制比较复杂。文章详细介绍了SDRAM存储器的结构、接口信号和操作方法,以及SDRAM控制器的设计方法。结合实际系统,设计给出了使用FPGA实现SD... SDRAM作为大容量存储器在高速图像处理中具有很大的应用价值。但由于SDRAM的结构和SRAM不同,其控制比较复杂。文章详细介绍了SDRAM存储器的结构、接口信号和操作方法,以及SDRAM控制器的设计方法。结合实际系统,设计给出了使用FPGA实现SDRAM控制器的硬件接口,在Altera公司的主流FPGA芯片EP1C6Q240C8上,通过增加流水级数和将输出触发器布置在IO单元中,该控制器可达到185MHz的频率。 展开更多
关键词 FPGA sdram sdram控制器
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基于FPGA的SDRAM控制器的设计和实现 被引量：25
7
作者 杨海涛 苏涛 巫幪 《电子科技》 2007年第1期8-12,共5页
为扩展TS-101处理器的外部SDRAM存储空间,提出一种基于FPGA的SDRAM控制器的实现方法。分析了所用SDRAM的特点、原理,介绍了SDRAM控制器的组成框图及各模块功能,给出了读写SDRAM的时序图以及SDRAM存储板的性能参数。FPGA中采用了模块化... 为扩展TS-101处理器的外部SDRAM存储空间,提出一种基于FPGA的SDRAM控制器的实现方法。分析了所用SDRAM的特点、原理,介绍了SDRAM控制器的组成框图及各模块功能,给出了读写SDRAM的时序图以及SDRAM存储板的性能参数。FPGA中采用了模块化设计方式,该设计将TS-101处理器的外部SDRAM存储空间扩展至512Mbyte。 展开更多
关键词 大容量存储器 sdram控制器 时序分析
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高速SDRAM控制器设计的FPGA实现 被引量：21
8
作者 张林 何春 《电子科技大学学报》 EI CAS CSCD 北大核心 2008年第S1期109-112,共4页
同步动态存储器(SDRAM)控制器通常用有限状态机实现,对于一般的设计方法,由于状态数量多,状态转换通常伴随大的组合逻辑而影响运行速度,因此,SDRAM控制器的速度限制了SDRAM存储器的访问速度。该文从结构优化入手来优化方法,利用状态机... 同步动态存储器(SDRAM)控制器通常用有限状态机实现,对于一般的设计方法,由于状态数量多,状态转换通常伴随大的组合逻辑而影响运行速度,因此,SDRAM控制器的速度限制了SDRAM存储器的访问速度。该文从结构优化入手来优化方法,利用状态机分解的思想将大型SDRAM控制状态机用若干小的子状态机实现,达到简化逻辑的目的,不仅提高了速度还节省了资源,对该类大型SDRAM控制器的实现有一定参考意义。 展开更多
关键词 现场可编程门阵列 高速状态机 sdram控制器 状态机分解
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基于DDR SDRAM控制器时序分析的模型 被引量：7
9
作者 程晓东 郑为民 唐志敏 《计算机工程》 CAS CSCD 北大核心 2005年第17期182-184,共3页
定义了时钟单位阶跃信号C(n),提出了一种利用带相对时钟坐标的逻辑方程表示逻辑信号的方法;通过对所设计的DDR SDRAM控制器的读写时序的分析,建立了控制器主要信号的时序表达式,并利用所建立的时钟逻辑方程对DDR控制器的读过程进行了简... 定义了时钟单位阶跃信号C(n),提出了一种利用带相对时钟坐标的逻辑方程表示逻辑信号的方法;通过对所设计的DDR SDRAM控制器的读写时序的分析,建立了控制器主要信号的时序表达式,并利用所建立的时钟逻辑方程对DDR控制器的读过程进行了简单的分析。这种方法可以应用到内存系统的带宽和延时估计方面,比较直观。 展开更多
关键词 时钟逻辑方程 DDR sdram控制器 时序模型
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具有时间隐藏特性的数据块读写SDRAM控制器 被引量：3
10
作者 王斌 熊志辉 +2 位作者 陈立栋 谭树人 张茂军 《计算机工程》 CAS CSCD 北大核心 2009年第4期244-246,共3页
针对SDRAM控制器读写数据块访问延时长、速度慢的问题,提出时间隐藏技术,将其应用于SDRAM控制器的设计,采用FPGA实现。实验结果表明,时间隐藏技术有效缩短了数据块读写访问延时,提高了读写速度,写4×4数据块可节约时间52%,读8×... 针对SDRAM控制器读写数据块访问延时长、速度慢的问题,提出时间隐藏技术,将其应用于SDRAM控制器的设计,采用FPGA实现。实验结果表明,时间隐藏技术有效缩短了数据块读写访问延时,提高了读写速度,写4×4数据块可节约时间52%,读8×8数据块可节约时间44%。 展开更多
关键词 时间隐藏 数据块 sdram控制器
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基于FPGA的DDR SDRAM控制器的实现 被引量：19
11
作者 吴健军 初建朋 赖宗声 《微计算机信息》 北大核心 2006年第01Z期156-157,共2页
随着现在各种处理器的工作频率越来越快,存储器的读写速度以及外围的控制电路的性能成为直接制约系统的性能的瓶颈。介绍了一种基于FPGA的DDRSDRAM控制器的设计。
关键词 DDR sdram控制器 FPGA tcac DLL
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数字系统中SDRAM控制器的FPGA实现 被引量：4
12
作者 范继 吴小役 +1 位作者 王斌翊 胡江峰 《火炮发射与控制学报》 北大核心 2009年第4期38-41,共4页
在诸如目标监视、雷达数据处理等需要对图像数据进行高速处理的数字系统中,大量利用同步动态存储器(SDRAM)作为数据的缓存。针对SDRAM的工作原理和时序特点,提出了一种基于FPGA的SDRAM控制器实现方法。采用硬件描述语言(VHDL)在Quartus... 在诸如目标监视、雷达数据处理等需要对图像数据进行高速处理的数字系统中,大量利用同步动态存储器(SDRAM)作为数据的缓存。针对SDRAM的工作原理和时序特点,提出了一种基于FPGA的SDRAM控制器实现方法。采用硬件描述语言(VHDL)在Quartus7.2环境下进行了设计与仿真,较好地实现了各种工作状态之间的跳转,仿真结果也完全符合SDRAM所要求的控制时序。最后在Altera公司的FP-GA上利用设计的控制器对Micron公司的SDRAM进行了验证,监测结果显示,SDRAM能够很好地完成规定读写操作。参数化设计也使得该控制器具有较好的通用性。 展开更多
关键词 电子技术 FPGA sdram控制器设计 VHDL 状态机
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面向逻辑设计的SDRAM控制器性能度量模型 被引量：3
13
作者 潘光荣 王沁 +1 位作者 齐悦 余美强 《计算机应用研究》 CSCD 北大核心 2009年第9期3432-3435,共4页
以SDRAM控制器为研究对象,探讨硬件逻辑设计时其性能度量的方法,通过建立一个硬件时钟周期级上的SDRAM控制器性能度量模型,在硬件逻辑实现的层次上实现了SDRAM控制器性能的评估。根据该性能度量模型,既可以分析已有设计的性能,又可以启... 以SDRAM控制器为研究对象,探讨硬件逻辑设计时其性能度量的方法,通过建立一个硬件时钟周期级上的SDRAM控制器性能度量模型,在硬件逻辑实现的层次上实现了SDRAM控制器性能的评估。根据该性能度量模型,既可以分析已有设计的性能,又可以启发SDRAM控制器的优化方案。在双向有线数字电视信道SoC系统平台上应用该度量模型对三个AMBA总线接口的SDRAM控制器实现方案的性能进行分析,从而验证该性能度量模型适用于评估和指导SDRAM控制器的设计。该实验方法还可以用来评价各个不同IP核提供商提供的SDRAM控制器IP核,以及评估SoC系统中一些其他IP核的性能。依据模型给出的量化分析信息,对优化设计具有启发性。 展开更多
关键词 sdram控制器 性能度量 逻辑设计 片上系统 IP核 AMBA总线
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实时视频采集系统的SDRAM控制器设计 被引量：7
14
作者 张文涛 王琼华 +1 位作者 李大海 张映权 《现代电子技术》 2009年第20期57-59,共3页
描述了一种在PAL→VGA的实时视频采集系统中图像数据处理的方法。针对实时视频采集系统一般使用2片SDRAM进行乒乓缓存的方式,给出一种使用一片SDRAM的不同BANK进行乒乓操作的相对容易实现的SDRAM控制器设计方法。该方法通过充分利用SDRA... 描述了一种在PAL→VGA的实时视频采集系统中图像数据处理的方法。针对实时视频采集系统一般使用2片SDRAM进行乒乓缓存的方式,给出一种使用一片SDRAM的不同BANK进行乒乓操作的相对容易实现的SDRAM控制器设计方法。该方法通过充分利用SDRAM的切换BANK存取操作并采用指令计数的方式进行读写状态转换,在PAL→VGA实时视频采集系统中实现了利用一片SDRAM进行图像缓存。它在实时视频采集系统中图像数据处理方面,具有良好的应用价值。 展开更多
关键词 视频采集 FPGA sdram控制器 乒乓操作
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计算密集型体系集成DDR SDRAM控制器设计 被引量：3
15
作者 江先阳 刘新春 +2 位作者 张佩珩 孙凝晖 徐志伟 《计算机工程与科学》 CSCD 2006年第3期96-97,101,共3页
文章介绍了计算密集型体系解决存储器访问瓶颈的研究趋势。针对计算密集型体系的高数据访存需求,提出并在FPGA上实现了一种集成的DDR SDRAM控制器,其关键部分为固化初始化系列和专有的定制系统总线。仿真结果和分析表明,该控制器解决了... 文章介绍了计算密集型体系解决存储器访问瓶颈的研究趋势。针对计算密集型体系的高数据访存需求,提出并在FPGA上实现了一种集成的DDR SDRAM控制器,其关键部分为固化初始化系列和专有的定制系统总线。仿真结果和分析表明,该控制器解决了计算密集型体系的数据访问瓶颈。 展开更多
关键词 计算密集型体系 DDR sdram控制器 FPGA 仿真
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多总线地面测试设备中双SDRAM控制器的设计 被引量：3
16
作者 刘延飞 杨铁阡 +1 位作者 李琪 倪亮 《电讯技术》 北大核心 2011年第4期31-34,共4页
针对某型导弹多总线地面测试设备传输数据量大、传输速度高的要求,设计了一种基于乒乓操作的SDRAM控制器作为测试设备数据缓存器。详细介绍了以FPGA为主控器的设计方案,包括SDRAM内部接口设计、数据传输过程以及乒乓操作的实现方法。通... 针对某型导弹多总线地面测试设备传输数据量大、传输速度高的要求,设计了一种基于乒乓操作的SDRAM控制器作为测试设备数据缓存器。详细介绍了以FPGA为主控器的设计方案,包括SDRAM内部接口设计、数据传输过程以及乒乓操作的实现方法。通过图像发生装置将图像数据发送给测试总线,对控制器功能进行验证,数据读写速率稳定达到125 Mbit/s,证明本控制器具有良好的性能,能够满足多总线地面测试设备的需求。 展开更多
关键词 地面测试设备 多总线 sdram控制器 乒乓操作
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LED显示控制系统中SDRAM控制器的设计 被引量：3
17
作者 郑喜凤 尹柱霞 严飞 《液晶与显示》 CAS CSCD 北大核心 2009年第3期423-428,共6页
对应用在LED显示控制系统中的SDRAM控制器进行了设计,实现了256×64像素点的实时显示控制,采用XILINX公司的现场可编程逻辑器件(FPGA)XC3S250E作为系统的硬件载体。动态内存的采用打破了静态RAM的使用局限,具有频率高、空间大和成... 对应用在LED显示控制系统中的SDRAM控制器进行了设计,实现了256×64像素点的实时显示控制,采用XILINX公司的现场可编程逻辑器件(FPGA)XC3S250E作为系统的硬件载体。动态内存的采用打破了静态RAM的使用局限,具有频率高、空间大和成本低的优点。本控制器采用VHDL语言进行程序编写,核心部分由状态机组成并采用新颖的读写方式来提高系统的总线利用率,具有较好的系统性和通用性。 展开更多
关键词 LED显示控制系统 sdram控制器 现场可编程逻辑器件 VHDL
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用Xilinx FPGA实现DDR SDRAM控制器 被引量：10
18
作者 夏玉立 雷宏 黄瑶 《微计算机信息》 北大核心 2007年第26期209-211,共3页
DDR SDRAM使用双倍数据速率结构,它能获得比SDRAM更高的性能。DDR SDRAM需要特定的DDR控制器才能完成与DSP、FPGA之间的通信。由于Xilinx VirtexTM-4系列FPGA具备ChipSync源同步技术等优势,本设计采用它来实现DDR SDRAM控制器。该DDR SD... DDR SDRAM使用双倍数据速率结构,它能获得比SDRAM更高的性能。DDR SDRAM需要特定的DDR控制器才能完成与DSP、FPGA之间的通信。由于Xilinx VirtexTM-4系列FPGA具备ChipSync源同步技术等优势,本设计采用它来实现DDR SDRAM控制器。该DDR SDRAM控制器采用直接时钟数据捕获技术,本文将重点阐述该技术。 展开更多
关键词 DDR sdram控制器 FPGA 状态机 直接时钟数据捕获
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利用FPGA实现SDRAM控制器的设计 被引量：9
19
作者 刘云清 佟首峰 姜会林 《长春理工大学学报（自然科学版）》 2005年第4期47-50,共4页
介绍了SDRAM的工作原理和使用方法。以一个数据通信中实际使用的SDRAM控制器为例,设计了用可编程逻辑器件(FPGA)实现SDRAM控制器的方法,给出了具体实现时需要注意的地方。
关键词 VHDL sdram(Synchorous DRAM) sdram控制器
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基于FPGA的全景图像处理系统SDRAM控制器设计与实现 被引量：3
20
作者 陆军 高乐 +1 位作者 刘涛 朱齐丹 《应用科技》 CAS 2012年第1期55-60,共6页
在对高分辨率折反射全景图像的快速采集处理中,同步动态随机存储器(SDRAM)作为重要的数据缓存器件,对于其正确的控制关系到整个系统能否正常工作.在分析了SDRAM各项参数及其工作原理的基础上,设计了基于FPGA的双SDRAM控制器,在乒乓缓存... 在对高分辨率折反射全景图像的快速采集处理中,同步动态随机存储器(SDRAM)作为重要的数据缓存器件,对于其正确的控制关系到整个系统能否正常工作.在分析了SDRAM各项参数及其工作原理的基础上,设计了基于FPGA的双SDRAM控制器,在乒乓缓存模式下轮流采集图像,完成了分辨率2048 dpi×2048 dpi、每秒15帧的CameraLink接口的全景图像的实时采集、缓存解算,以及以1024 dpi×768 dpi的分辨率进行实时显示. 展开更多
关键词 图像处理 折反射全景 FPGA sdram控制器 乒乓缓存 CameraLink接口
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