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一种新型纳米器件逻辑纠错专用集成电路架构 被引量：1
1
作者 窦怀阳 薛晓勇 冯洁 《半导体技术》 CAS 北大核心 2020年第2期116-121,共6页
新型纳米器件被视为摩尔定律极限临近情况下CMOS技术的有力补充。为克服新型纳米器件缺陷率高的问题,提出了一种基于现场可编程纳米线互连(FPNI)架构的具有自修正能力的纠错(FT)专用集成电路(ASIC)架构FT-FPNI,这种架构适用于易出错的... 新型纳米器件被视为摩尔定律极限临近情况下CMOS技术的有力补充。为克服新型纳米器件缺陷率高的问题,提出了一种基于现场可编程纳米线互连(FPNI)架构的具有自修正能力的纠错(FT)专用集成电路(ASIC)架构FT-FPNI,这种架构适用于易出错的纳米器件逻辑门电路。使用基于硬件描述语言的缺陷注入技术来仿真架构,仿真结果表明,这种架构可以100%检测缺陷和错误。为取得最小的纠错代价,需要保持尽可能小的单元阵列尺寸。Hspice软件仿真结果表明,碳纳米管或非(NOR)门输出延迟为2.89 ps,平均功耗为6.748 pW,与现有CMOS技术相比功耗降低2个数量级。 展开更多
关键词 内嵌自修复(BISR) 现场可编程纳米线互连(FPNI) 纳米器件逻辑 碳纳米管场效应管(CNTFET) 电路纠错
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模糊控制器专用集成电路的设计与实现
2
作者 袁欣 干萌 +1 位作者 蓝鸿翔 常健翔 《微电子学》 CAS CSCD 1996年第1期24-28,共5页
提出了一种用数字逻辑电路设计模糊控制器的方法。该模糊控制器电路不用ＣＰＵ，全部算法由数字逻辑电路实现，具有运算速度快的特点，适合于需要高速控制的场合。该模糊控制器电路具有被激活的规则自动生成功能，不需要大规模的ＲＡＭ... 提出了一种用数字逻辑电路设计模糊控制器的方法。该模糊控制器电路不用ＣＰＵ，全部算法由数字逻辑电路实现，具有运算速度快的特点，适合于需要高速控制的场合。该模糊控制器电路具有被激活的规则自动生成功能，不需要大规模的ＲＡＭ或ＲＯＭ存储模糊规则，电路规模小，易于实现，特别适合于输出控制量为离散值的应用场合。已在一片ＦＰＧＡＸｉｌｉｎｘ４０１０ＰＧ１９１－６上实现了该模糊控制器电路，并成功地应用于温控系统。 展开更多
关键词 数字集成电路 模糊控制器 设计
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基于权重的超大规模集成电路布图规划算法 被引量：6
3
作者 赵长虹 陈建 +2 位作者 周电 周晓方 孙劼 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2006年第7期994-998,共5页
针对超大规模集成电路布图规划问题各个模块的面积以及长边长度的不同,提出权重的概念,并根据各个模块权重的不同;在优化过程中以不同概率选择相应的模块,克服了原有算法以相同的概率选择各个模块的缺点,达到了更好的布图规划效果.
关键词 布图规划 权重
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CMOS集成电路低功耗设计方法 被引量：14
4
作者 徐芝兰 杨莲兴 《微电子学》 CAS CSCD 北大核心 2004年第3期223-226,共4页
　近年来,功耗问题已成为VLSI设计,尤其是在电池供电的应用中必须考虑的重要问题之一。文章通过对CMOS集成电路功耗起因的分析,对CMOS集成电路低功耗设计方法[1]和设计工具进行了深入的讨论。
关键词 CMOS 集成电路 低功耗设计
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集成电路芯片上光互连研究的新进展 被引量：2
5
作者 阮刚 肖夏 +3 位作者 R.Streiter 陈智涛 T.Otto T.Gessner 《Journal of Semiconductors》 EI CAS CSCD 北大核心 2001年第4期387-397,共11页
讨论了集成电路向高集成度、高工作频率和高传输速率继续发展时 ,常规金属互连出现的困难以及集成电路芯片上光互连具有的潜在优势 .介绍了组成芯片上光互连的光发射器件、光接收器件和光传输器件等三种基本器件及其与硅集成电路集成的... 讨论了集成电路向高集成度、高工作频率和高传输速率继续发展时 ,常规金属互连出现的困难以及集成电路芯片上光互连具有的潜在优势 .介绍了组成芯片上光互连的光发射器件、光接收器件和光传输器件等三种基本器件及其与硅集成电路集成的研究新进展 .最后展望了集成电路芯片上光互连的应用前景 . 展开更多
关键词 集成电路 光互连 光发射器件 光接收器件 光传输器件
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一种改进型除法集成电路的设计
6
作者 莫凡 俞军 章倩苓 《微电子学》 CAS CSCD 北大核心 1999年第2期132-136,共5页
介绍了一种改进的除法集成电路，该电路适合于对精度要求很高、而对速度要求不高的应用场合。它对原有的除法实现算法做了调整，减小了运算误差，同时减少了所需的器件数量，从而缩小了芯片面积。
关键词 除法集成电路 计数器 专用集成电路 设计
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专业集成电路设计中三次多项式实现的新结构
7
作者 莫凡 俞军 章倩苓 《系统工程与电子技术》 EI CSCD 1999年第8期64-66,共3页
专业集成电路（ＡｐｐｌｉｃａｔｉｏｎＳｐｅｃｉｆｉｃＩｎｔｅｒｇｒａｔｅｄＣｉｒｃｕｉｔ，ＡＳＩＣ）设计中的三次多项式计算，存在着一类典型的应用问题，即自变量是累积形成的，待自变量完整形成后再行直接计算是低效的。提出... 专业集成电路（ＡｐｐｌｉｃａｔｉｏｎＳｐｅｃｉｆｉｃＩｎｔｅｒｇｒａｔｅｄＣｉｒｃｕｉｔ，ＡＳＩＣ）设计中的三次多项式计算，存在着一类典型的应用问题，即自变量是累积形成的，待自变量完整形成后再行直接计算是低效的。提出一种改进的三次多项式算法，在保证和直接算法相同精度的条件下，以较少的电路元件实现计算功能。同时，本算法从自变量完整形成到给出最终结果的延迟很小。 展开更多
关键词 专业集成电路 多项式 差分方程 设计
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模拟集成电路的仿真与优化方法概述 被引量：1
8
作者 杨帆 《微纳电子与智能制造》 2021年第2期80-85,共6页
与数字集成电路不同,模拟集成电路的设计主要依靠电路仿真和人工经验来完成设计。模拟集成电路的仿真对于传统设计方法至关重要。随着机器学习和人工智能技术的发展,基于机器学习和人工智能的智能优化和自动化版图设计也逐渐发展起来。... 与数字集成电路不同,模拟集成电路的设计主要依靠电路仿真和人工经验来完成设计。模拟集成电路的仿真对于传统设计方法至关重要。随着机器学习和人工智能技术的发展,基于机器学习和人工智能的智能优化和自动化版图设计也逐渐发展起来。本文介绍了模拟电路的仿真的发展历史及最新进展,以及基于机器学习和人工智能的智能优化和自动化版图设计的最新进展,最后展望模拟集成电路的仿真与优化的未来发展趋势。 展开更多
关键词 分析 建模 优化 模拟集成电路 综述
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基于模拟退火的三维集成电路水冷散热网络优化算法 被引量：1
9
作者 胡风 朱恒亮 曾璇 《复旦学报（自然科学版）》 CAS CSCD 北大核心 2017年第4期480-487,共8页
三维集成电路(3D-IC)通过在垂直方向堆叠多层芯片有效提高了芯片的性能和集成度.然而,过高的功率密度和温度成为3D-IC集成度提高的最大障碍.水冷散热技术将冷却液注入两层芯片间的沟道有效解决了3D-IC的散热问题,同时也带来了过高温度... 三维集成电路(3D-IC)通过在垂直方向堆叠多层芯片有效提高了芯片的性能和集成度.然而,过高的功率密度和温度成为3D-IC集成度提高的最大障碍.水冷散热技术将冷却液注入两层芯片间的沟道有效解决了3D-IC的散热问题,同时也带来了过高温度梯度的问题以及对散热功耗,芯片可靠性的要求.本文提出一种在有硅穿孔限制下的基于模拟退火的沟道网络优化算法,算法基于温度仿真,对散热沟道进行放置与填充操作,设计出的沟道网络可以有效降低散热功率和温度梯度.实验中,与传统的均匀直沟道的设计方法相比,我们的方法可以在相同最高温和温度梯度限制条件下,降低散热功率达67.0%. 展开更多
关键词 三维芯片 水冷散热 沟道网络优化 模拟退火
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射频集成电路周期稳态快速模拟算法的研究
10
作者 武新宇 来金梅 +2 位作者 章倩苓 Omar Wing 任俊彦 《微电子学》 CAS CSCD 北大核心 2002年第3期161-164,共4页
使用拟牛顿 ( Newton)算法 ,不用计算 Jacobi矩阵 ,保留了 Newton法的超线性收敛特性 ,是求解大规模非线性方程组的有效方法。文章提出了应用拟 Newton法快速求解电路周期稳态响应的拟 Newton打靶法和拟 Newton谐波平衡法。实验结果表... 使用拟牛顿 ( Newton)算法 ,不用计算 Jacobi矩阵 ,保留了 Newton法的超线性收敛特性 ,是求解大规模非线性方程组的有效方法。文章提出了应用拟 Newton法快速求解电路周期稳态响应的拟 Newton打靶法和拟 Newton谐波平衡法。实验结果表明 ,拟 Newton打靶法和拟 展开更多
关键词 射频集成电路 周期稳态快速模拟算法 打靶法 谐波平衡 拟牛顿法
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智能测量集成电路的设计与仿真
11
作者 何建军 俞军 章倩苓 《微电子学》 CAS CSCD 北大核心 2001年第2期112-114,共3页
文章以电子体重秤专用集成电路为例 ,介绍了基于嵌入式 MPU的智能测量专用集成电路的设计及硬件仿真。在一块芯片内实现了数据采集、数据处理、数据显示等智能测量系统所需完成的功能 ,并在所设计的硬件仿真系统中 ,通过硬件仿真 ,验证... 文章以电子体重秤专用集成电路为例 ,介绍了基于嵌入式 MPU的智能测量专用集成电路的设计及硬件仿真。在一块芯片内实现了数据采集、数据处理、数据显示等智能测量系统所需完成的功能 ,并在所设计的硬件仿真系统中 ,通过硬件仿真 ,验证了系统功能的正确性 ,为目标芯片提供了软件开发平台。并且该设计具有较强的通用性 。 展开更多
关键词 专用集成电路 智能测量 电路仿真 电路设计
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并行空间自适应多重网格集成电路热分析方法
12
作者 卢章疑 杨帆 曾璇 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2012年第8期1020-1026,共7页
针对集成电路设计阶段的重要步骤之一——热分析中的稳态分析问题,将多线程并行计算技术和目前最先进的空间自适应多重网格方法相结合,提出一种基于多核并行空间自适应多重网格的热分析方法.根据CPU的核数对芯片进行区域划分,并根据划... 针对集成电路设计阶段的重要步骤之一——热分析中的稳态分析问题,将多线程并行计算技术和目前最先进的空间自适应多重网格方法相结合,提出一种基于多核并行空间自适应多重网格的热分析方法.根据CPU的核数对芯片进行区域划分,并根据划分情况构造适用于块Jacobi迭代的分块热导矩阵,每一个划分区域对应一个矩阵子块.对全局的稳态热分析问题采用块Jacobi迭代法,每一次块Jacobi迭代需要并行地计算每个子块方程组,每个子块方程组的计算采用空间自适应多重网格方法;用八叉森林数据结构记录每个子块的网格层次信息,为多重网格计算提供不同网格层次下的热导矩阵.实验结果表明,文中方法在保证稳态热分析精度的前提下,在32核CPU上可以达到近似线性的理想加速比,能够有效地应用于集成电路设计流程,提高热分析效率. 展开更多
关键词 集成电路热分析 多核并行 多重网格
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射频电路PDE-ODE耦合系统瞬态仿真算法研究
13
作者 来金梅 谭俊 +2 位作者 章倩苓 任俊彦 Omar Wing 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2003年第4期495-499,共5页
研究基于MOSFETPDE模型的射频电路瞬态仿真算法 研究表明 :采用开窗技术可以扩大射频电路PDE ODE耦合系统边界松驰迭代收敛的初始猜值选择范围 ,使得迭代过程收敛容易且快速 ,能明显地改善基于MOSFETPDE模型的射频电路PDE
关键词 射频电路 PDE-ODE 耦合系统 瞬态仿真算法 波形松弛法 开窗技术 射频集成电路
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MPEG-1系统解码电路的一种VLSI结构
14
作者 徐阳 周汀 章倩苓 《微电子学》 CAS CSCD 北大核心 1998年第6期407-411,共5页
根据ＭＰＥＧ－１系统流的特点，用有限状态机的方案设计出ＭＰＥＧ系统解码电路的ＶＬＳＩ结构。该结构具有数据处理速度快和芯片面积小的特点。同时，状态优化和抗错能力强，有较强的实用性。
关键词 VLSI 解码电路 系统流 MPEG 有限状态机
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一种功率测量专用数字信号处理器的实时仿真系统
15
作者 莫凡 俞军 章倩苓 《电子技术应用》 北大核心 1999年第2期8-10,共3页
介绍一种功率测量专用数字信号处理器的实时仿真系统，其仿真速度高、实时性强、且成本低廉，具备了软件模拟不可比拟的优越性。使用该仿真系统，可以确定目标芯片的一些重要参数、以及算法实现中的常数；同时，该仿真系统的系统分割、... 介绍一种功率测量专用数字信号处理器的实时仿真系统，其仿真速度高、实时性强、且成本低廉，具备了软件模拟不可比拟的优越性。使用该仿真系统，可以确定目标芯片的一些重要参数、以及算法实现中的常数；同时，该仿真系统的系统分割、优化，也对目标芯片的设计有着重要的指导意义。 展开更多
关键词 实时仿真 数字信号处理器 功率测量 DSP
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参数可选的高速椭圆曲线密码专用芯片的VLSI实现 被引量：13
16
作者 曾晓洋 周晓方 +3 位作者 沈泊 李文宏 陈超 章倩苓 《通信学报》 EI CSCD 北大核心 2003年第9期35-41,共7页
研究了椭圆曲线密码体制的VLSI实现问题。从点乘运算层与群运算层调度到有限域上的高速运算方法等方面给出了一些提高椭圆曲线上点乘运算的新方案;提出了一种域与曲线参数可选择的高速椭圆曲线密码专用芯片VLSI新结构。基于0.6mm单元库... 研究了椭圆曲线密码体制的VLSI实现问题。从点乘运算层与群运算层调度到有限域上的高速运算方法等方面给出了一些提高椭圆曲线上点乘运算的新方案;提出了一种域与曲线参数可选择的高速椭圆曲线密码专用芯片VLSI新结构。基于0.6mm单元库,芯片面积约为36mm2。综合后仿真结果表明:设计芯片能够有效地完成数字签名与身份验证完整流程,在20MHz下平均每次签名时间为62.67ms,高于目前报道的其它同类芯片。 展开更多
关键词 VLSI 椭圆曲线密码芯片 点乘运算 有限域 数字签名
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量子遗传算法在多输出Reed-Muller逻辑电路最佳极性搜索中的应用 被引量：16
17
作者 汪鹏君 李辉 +3 位作者 吴文晋 王伶俐 张小颖 戴静 《电子学报》 EI CAS CSCD 北大核心 2010年第5期1058-1063,共6页
量子遗传算法是一种融合量子计算和遗传算法优点的智能算法,常用于求解组合优化问题.本文给出多输出RM(Reed-Muller)逻辑电路最佳极性搜索方案,将量子遗传算法应用到多输出固定极性RM电路逻辑优化中.针对量子遗传算法易陷入局部极值的缺... 量子遗传算法是一种融合量子计算和遗传算法优点的智能算法,常用于求解组合优化问题.本文给出多输出RM(Reed-Muller)逻辑电路最佳极性搜索方案,将量子遗传算法应用到多输出固定极性RM电路逻辑优化中.针对量子遗传算法易陷入局部极值的缺陷,结合群体灾变思想,提出一种基于量子遗传算法的多输出RM逻辑电路最佳极性搜索算法.最后对多个大规模PLA格式基准电路测试表明:该算法与基于遗传算法的最佳极性搜索相比,在优化能力、寻优性能和收敛速度等方面都有不同程度的提高. 展开更多
关键词 量子遗传算法 极性搜索 多输出RM电路 逻辑优化
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时隙ALOHA法在RFID系统防碰撞问题中的应用 被引量：24
18
作者 胡建赟 李强 闵昊 《应用科学学报》 CAS CSCD 北大核心 2005年第5期489-492,共4页
时隙ALOHA法是射频识别(RFID)系统中常用的防碰撞算法,该文在分析RFID系统识别过程后引进马尔可夫链来为时隙ALOHA法建模,并根据此模型对时隙ALOHA法的性能进行分析,得到时隙数、RFID系统中所含的应答器数与识别成功率的关系,从而对实... 时隙ALOHA法是射频识别(RFID)系统中常用的防碰撞算法,该文在分析RFID系统识别过程后引进马尔可夫链来为时隙ALOHA法建模,并根据此模型对时隙ALOHA法的性能进行分析,得到时隙数、RFID系统中所含的应答器数与识别成功率的关系,从而对实际应用提供理论指导. 展开更多
关键词 时隙ALOHA 射频识别 防碰撞 马尔可夫链
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基于共模电平偏移电路新型CMOS低电压满幅度运放设计 被引量：9
19
作者 林越 徐栋麟 +1 位作者 任俊彦 许俊 《Journal of Semiconductors》 EI CAS CSCD 北大核心 2002年第5期529-534,共6页
针对电源电压为 1V甚至更低的应用环境 ,给出了一种基于共模电平偏移电路的新型 rail- to- rail运放结构 ,相对以往同类电路具有很好的对称性和较高的输入阻抗 ,并对之进行了详细的讨论 .在整个共模输入电压范围内 ,其单位增益带宽随共... 针对电源电压为 1V甚至更低的应用环境 ,给出了一种基于共模电平偏移电路的新型 rail- to- rail运放结构 ,相对以往同类电路具有很好的对称性和较高的输入阻抗 ,并对之进行了详细的讨论 .在整个共模输入电压范围内 ,其单位增益带宽随共模电压变化仅为 0 .0 5 % . 展开更多
关键词 CMOS RAIL-TO-RAIL 共模电平偏移电路 运算放大器 低电压
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一种优化的射频接收前端电路 被引量：6
20
作者 王静光 王金菊 +2 位作者 黄煜梅 沈维伦 洪志良 《微电子学》 CAS CSCD 北大核心 2006年第2期209-212,216,共5页
介绍了一种直接混频的无线局域网802.11b接收机前端电路。在考虑输入寄生的前提下,对射频输入端的阻抗匹配和噪声性能进行了优化;提出了一种适合低电源电压工作的新混频器结构;整个接收前端电路采用直流耦合的方式,增加一个负反馈低通... 介绍了一种直接混频的无线局域网802.11b接收机前端电路。在考虑输入寄生的前提下,对射频输入端的阻抗匹配和噪声性能进行了优化;提出了一种适合低电源电压工作的新混频器结构;整个接收前端电路采用直流耦合的方式,增加一个负反馈低通滤波器,以消除直流偏差,减少低频噪声。电路采用SMIC 0.18μm CMOS工艺,仿真结果显示,整个接收机的噪声系数为5.2 dB,输入三阶交调IIP3为-14.5 dBm。1.8 V电源电压下,功耗为100 mW左右。 展开更多
关键词 射频集成电路 直接混频 零中频 接收机 无线局域网 直流偏差 1/f噪声
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