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时延驱动的门阵和标准单元布图系统——Tiger
1
作者
洪先龙
蔡懿慈
+5 位作者
乔长阁
黄浦江
康志伟
薛天雄
葛守仁
程中宽
《清华大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
1997年第1期1-4,共4页
Ｔｉｇｅｒ可以完成从布局到详细布线的整个布图全过程。在整个布图过程中，根据ＲＣ延迟模型计算所有连线的延迟，并把整个芯片的时延最小作为优化目标。在Ｔｉｇｅｒ系统中，应用了性能驱动的布局和总体布线算法、ＤＲＡＦＴ通道布线...
Ｔｉｇｅｒ可以完成从布局到详细布线的整个布图全过程。在整个布图过程中，根据ＲＣ延迟模型计算所有连线的延迟，并把整个芯片的时延最小作为优化目标。在Ｔｉｇｅｒ系统中，应用了性能驱动的布局和总体布线算法、ＤＲＡＦＴ通道布线算法和基于垂直通道模型的走线道分配算法。实验结果表明，Ｔｉｇｅｒ的布图速度要比ＴｉｍｂｅｒＷｏｌｆ６．０快很多。它在保证芯片性能的同时，其芯片面积与ＴｉｍｂｅｒＷｏｌｆ差不多。
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关键词
时延驱动
标准单元
门阵列
布图
集成电路
布线
原文传递
题名
时延驱动的门阵和标准单元布图系统——Tiger
1
作者
洪先龙
蔡懿慈
乔长阁
黄浦江
康志伟
薛天雄
葛守仁
程中宽
机构
清华
大学
计算机科学与技术
系
美国加州大学berkeley分校电机工程系
美国加州大学
SanDiego
分校
计算机科学与
工程
系
出处
《清华大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
1997年第1期1-4,共4页
基金
国家"八五"和"九五"科技攻关项目
国家自然科学基金
文摘
Ｔｉｇｅｒ可以完成从布局到详细布线的整个布图全过程。在整个布图过程中，根据ＲＣ延迟模型计算所有连线的延迟，并把整个芯片的时延最小作为优化目标。在Ｔｉｇｅｒ系统中，应用了性能驱动的布局和总体布线算法、ＤＲＡＦＴ通道布线算法和基于垂直通道模型的走线道分配算法。实验结果表明，Ｔｉｇｅｒ的布图速度要比ＴｉｍｂｅｒＷｏｌｆ６．０快很多。它在保证芯片性能的同时，其芯片面积与ＴｉｍｂｅｒＷｏｌｆ差不多。
关键词
时延驱动
标准单元
门阵列
布图
集成电路
布线
Keywords
timing driven
standard cell
gate array
layout
分类号
TN405.97 [电子电信—微电子学与固体电子学]
原文传递
题名
作者
出处
发文年
被引量
操作
1
时延驱动的门阵和标准单元布图系统——Tiger
洪先龙
蔡懿慈
乔长阁
黄浦江
康志伟
薛天雄
葛守仁
程中宽
《清华大学学报（自然科学版）》
EI
CAS
CSCD
北大核心
1997
0
原文传递
已选择
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